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成本優化的 FPGA 和 SoC

廣泛係列的自適應解決方案,充分滿足成本敏感型應用需求

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推出 AU7P FPGA 和 ZU3T SoC

全新 UltraScale+ 器件通過 12.5 Gbps 收發器實現低成本和低功耗。

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安心設計

7 係列器件的现金网博e百 生命周期至少延長至 2035 年

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概述

“任意”互聯

傳感器融合

精確控製

安全與安防功能

圖像處理

分析與雲

16NM ULTRASCALE+™ 成本優化的现金网博e百 組合

出色的性能功耗比
功耗敏感型應用

Artix® UltraScale+™ 係列擁有高速 I/O 和高速 DSP 計算 FPGA,可提供高達 192Gb 的聚合帶寬,是視覺、視頻、網絡與存儲應用的理想選擇。Zynq® UltraScale+ MPSoC 器件將 Arm® 處理器子係統和可編程邏輯 UltraScale™ 架構集成在單個器件中。

高計算密度
超小型封裝

現已供貨的器件提供 InFO 封裝選項,尺寸和厚度均銳減 70%,散熱足跡更小。輸出與較大封裝相同的計算,這些 InFO 外形尺寸的器件在其各自類別中產生最高的計算、吞吐量和信號處理/mm2

可在整個 UltraScale+ 中進行擴展
FPGA & SoC

這些全新器件采用相同的 16 納米架構,豐富了業經驗證的龐大现金网博e百 係列,有助於真人百家乐游戏开户 保護並充分利用對軟件、IP、工具和 PCB 設計的投資。 一旦設計,就能跨多種不同器件部署,充分滿足終端现金网博e百 係列需求。

7 係列成本優化的现金网博e百 組合

廣泛的现金网博e百 組合,包含 3 個針對特定功能優化的係列

spartan-7 fpga chip
spartan-7 fpga chip

I/O 優化
領先的單位功耗性能

Spartan®-7 器件將 7 係列 28 納米可編程邏輯與高 I/O 數相結合,是任意對任意互聯、傳感器融合及嵌入式視覺應用的理想選擇

artix-7 chip
artix-7 logo

收發器優化

Artix-7 係列不僅配備多達 16 個 6.6Gb/s 的收發器,而且還支持 DDR3,可為諸如軟件定義無線電和低端無線回程等低功耗應用實現最大價值

zynq-7000 chip
zynq-7000 logo

硬件與軟件
靈活應變的 SoC

對於通常將應用處理器與 FPGA 配對的應用而言,Zynq-7000 SoC 屬於單芯片解決方案,不僅可消除裸片對裸片的時延,同時還可降低材料清單成本。

安心設計

AMD Xilinx 鄭重承諾支持長现金网博e百 生命周期。我們很高興正式宣布,對所有 7 係列 FPGA 和自適應 SoC 的支持將至少延長至 2035 年。這其中包括我們的成本優化型 Spartan-7 和 Artix-7 FPGA、我們的整個 Zynq®-7000 SoC 现金网博e百 組合,以及 Kintex®-7 與 Virtex®-7 FPGA。所有速率和溫度等級均包含在內。

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高性能與高靈活性,解決廣泛的行業問題

Spartan-7 FPGA Artix-7 FPGA Artix UltraScale+ FPGA Zynq-7000 SoC
Z-7007S、Z-7012S、Z-7014S、Z-7010、Z-7015、Z-7020
Zynq UltraScale+ MPSoC
ZU1, ZU2, ZU3, ZU3T
邏輯單元 / 係統邏輯單元 (K) 102 215 308 85 157
RAM (Mb) 總數* 5.4 16.0 15.2 5.9 21.2
DSP slice 160 740 1200 220 576
收發器計數 @ 速度 (Gb/s) - 16 @ 6.6 16 @ 6.6 4 @ 6.6 4 @ 6.0 和 8 @ 12.5
DDR 接口速度 (Mb/s) DDR3 @ 800 DDR3 @ 1,066 DDR4 @ 2,400 DDR3 @ 1,066 DDR4 @ 2,666
PCI Express® 接口 - Gen 2x4 Gen4x8 Gen 2x4 Gen 3x8
I/O 引腳 400 14.500 304 328 252
處理係統
應用處理單元 - - - 單核/雙核 Arm® Cortex®-A9 雙核/四核 Arm Cortex-A53
實時處理器單元 - - - - 雙核 Arm Cortex-R5F
圖形處理單元 - - - Mali™-400MP2
存儲接口 - - - DDR3、DDR3L、DDR2、LPDDR2、2x Quad-SPI、NAND、NOR x16:DDR4 不帶 ECC;x32/x64:DDR4、LPDDR4、DDR3、DDR3L、LPDDR3 w/ ECC 2x 四通道 SPI、NAND

* RAM 總數 = 最大分布式 RAM + 總 Block RAM + UltraRAM

不確定哪個现金网博e百 係列適合您的設計嗎? 請查看完整的现金网博e百 選型指南